PCB設(shè)計公司用并行設(shè)計的注意事項
發(fā)表時間：2020-08-30 09:03:18 人氣：2889
隨著它們承載的器件的復(fù)雜性提高，PCB設(shè)計也變得越來越復(fù)雜。相當(dāng)長一段時間以來，電路設(shè)計工程師一直相安無事地獨立進行自己的設(shè)計，然后將完成的電路圖設(shè)計轉(zhuǎn)給PCB設(shè)計工程師，PCB設(shè)計工程師獨立完整自己的工作后，將Gerber文件再轉(zhuǎn)給PCB制造廠。電路設(shè)計工程師、PCB設(shè)計工程師和PCB制造廠的工作都是相互隔離的，少有溝通。
隨著采用大型BGA封裝的可編程器件的應(yīng)用不斷普及，以及高密度互連(HDI)、時序關(guān)鍵的差分對信令的廣泛應(yīng)用，現(xiàn)在再采用這樣一種相互隔離的PCB設(shè)計方式將帶來災(zāi)難性后果,而并行開發(fā)流程允許多個開發(fā)過程同步進行，有助于確保設(shè)計成功，避免延誤、額外開銷以及返工。本文總結(jié)了并行PCB設(shè)計各個階段的關(guān)鍵準(zhǔn)則。
PCB設(shè)計的第一步是在概念階段。這時，電路設(shè)計工程師應(yīng)該與PCB設(shè)計工程師一起進行技術(shù)評估。這個評估應(yīng)考慮這么一些問題：
1. 采用哪些器件？
2. 器件選用哪種封裝？管腳數(shù)多少？管腳配置怎樣？
3. 基于成本和性能的權(quán)衡，采用幾層PCB？
4. 時鐘頻率和信令速度等參數(shù)的目標(biāo)值是什么？
此外，設(shè)計工程師還應(yīng)考慮總線架構(gòu)、是采用并行還是串行連接等因素，以及阻抗匹配策略。阻抗不匹配時會出現(xiàn)反射、振鈴及其它不期望的干擾。
協(xié)同工作
PCB設(shè)計的這些考慮提出了成功PCB設(shè)計中的一個關(guān)鍵問題是溝通，因為PCB設(shè)計不再是一個人的工作，而是不同組的工程師之間的團隊合作。溝通這一主旨貫穿整個PCB設(shè)計流程的始終，電路設(shè)計團隊必須清楚地就其設(shè)計意圖與PCB設(shè)計團隊進行溝通，他們還必須在清楚了解其PCB設(shè)計工具能干什么、不能做什么的前提下參與到該過程中。
隨著PCB布線的復(fù)雜性日益增加，信號速率日益提高，協(xié)同的PCB設(shè)計方式可比傳統(tǒng)的串行流程得到更好效。將對元件的研究和選擇與整個設(shè)計流程的其它部分隔離開，以及將原理圖輸入、仿真與布局布線階段也獨立出來一直是常用手法。因此，設(shè)計工程師最好選擇便于分享數(shù)據(jù)的工具和流程，這是在分布在不同地方的設(shè)計團隊能利用并行工作的好處并縮短整個設(shè)計周期的唯一途徑。
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